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| FPGA原型验证板 | 2.0/ | 100000.0 | 图元 | PD-VU9P-LSI | [{"key":"1","value":"（一）FPGA芯片：\n单颗芯片拥有不低于2800K逻辑单元，不低于320Mb RAM，不低于6000 DSP；\n（二）板卡连接器要求：\nA.不少于700个IO引脚；\nB.接口电压可以通过上位机实时控制进行调节，支持不少于1.2V;1,35V;1.5V及1.8V四种调节电压。\n（三）板卡时钟要求：\nA.不低于8路全局时钟：具备PLL可编程时钟和外部晶振时钟接入能力\nB.不少于2路复位信号，可通过上位机软件或板上按钮实现\n（四）FPGA程序支持如下配置方式：\nA.千兆以太网\nB.USB\nC.JTAG\nD.Micro SD卡\n（五）配套扩展与存储支持：\nA. 支持DDR4内存扩展子卡，提供高速数据缓存与存储能力；\nB. 配备PCIe x8接口扩展卡，支持高速数据传输与外部设备连接；\nC. 提供完整的配件套装，包括必要的连接线、散热模块及安装支架，确保系统稳定运行","important":true}] | 质保1年，按行业标准提供服务 | |
| FPGA原型验证板 | 2.0/ | 100000.0 | 洪雪信息 | S7-9P | [{"key":"1","value":"（一）FPGA芯片：\n单颗芯片拥有不低于2800K逻辑单元，不低于320Mb RAM，不低于6000 DSP；\n（二）板卡连接器要求：\nA.不少于700个IO引脚；\nB.接口电压可以通过上位机实时控制进行调节，支持不少于1.2V;1,35V;1.5V及1.8V四种调节电压。\n（三）板卡时钟要求：\nA.不低于8路全局时钟：具备PLL可编程时钟和外部晶振时钟接入能力\nB.不少于2路复位信号，可通过上位机软件或板上按钮实现\n（四）FPGA程序支持如下配置方式：\nA.千兆以太网\nB.USB\nC.JTAG\nD.Micro SD卡\n（五）配套扩展与存储支持：\nA. 支持DDR4内存扩展子卡，提供高速数据缓存与存储能力；\nB. 配备PCIe x8接口扩展卡，支持高速数据传输与外部设备连接；\nC. 提供完整的配件套装，包括必要的连接线、散热模块及安装支架，确保系统稳定运行","important":true}] | 质保1年，按行业标准提供服务 | |
| FPGA原型验证板 | 2.0/ | 100000.0 | 太琴 | Veritiger-V9P | [{"key":"1","value":"（一）FPGA芯片：\n单颗芯片拥有不低于2800K逻辑单元，不低于320Mb RAM，不低于6000 DSP；\n（二）板卡连接器要求：\nA.不少于700个IO引脚；\nB.接口电压可以通过上位机实时控制进行调节，支持不少于1.2V;1,35V;1.5V及1.8V四种调节电压。\n（三）板卡时钟要求：\nA.不低于8路全局时钟：具备PLL可编程时钟和外部晶振时钟接入能力\nB.不少于2路复位信号，可通过上位机软件或板上按钮实现\n（四）FPGA程序支持如下配置方式：\nA.千兆以太网\nB.USB\nC.JTAG\nD.Micro SD卡\n（五）配套扩展与存储支持：\nA. 支持DDR4内存扩展子卡，提供高速数据缓存与存储能力；\nB. 配备PCIe x8接口扩展卡，支持高速数据传输与外部设备连接；\nC. 提供完整的配件套装，包括必要的连接线、散热模块及安装支架，确保系统稳定运行","important":true}] | 质保1年，按行业标准提供服务 |
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